CPLD: Add TX Q invert mechanism.

firmware/cpld/sgpio_if/top.jed

@@ -1,5 +1,5 @@
 Programmer Jedec Bit Map
-Date Extracted: Mon Aug  4 21:44:14 2014
+Date Extracted: Sat Aug 16 17:13:17 2014
 
 QF25812*
 QP100*
@@ -17,7 +17,7 @@ L000016 1110101011111111*
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 Note Block 1 PLA AND array *
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 L009248 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L009328 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
@@ -266,46 +266,46 @@ L009488 111111111111111111111111111111111111111111111111111111111111111111111111
 L009568 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L009648 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L009728 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L009808 11111111010111111111111111111111111111111111111111111111111111111111111111111111*
+L009808 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L009888 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L009968 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010048 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010128 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010208 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L010288 11111101110111111111111111111111111111111111111111111111111111111111111111111111*
+L010288 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010368 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010448 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L010528 11111111110111111101111111111111111111111111111111111111111111111111111111111111*
+L010528 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010608 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010688 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L010768 11111111110111111111011111111111111111111111111111111111111111111111111111111111*
+L010768 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010848 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L010928 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L011008 11111111110111111111111111111111011111111111111111111111111111111111111111111111*
+L011008 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L011088 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L011168 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L011248 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
+L011248 11111101111111111111111111111111111111111111111111111111111111111111111111111111*
 L011328 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
 L011408 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
-L011488 11111111111111111111111111111111111111111111111111111111111111111111111111111111*
+L011488 11111101111111111111111111111111111111111111111111111111111111111111111111111111*
 
 Note Block 1 PLA OR array *
-L011568 1111111111111111*
+L011568 1111111111111011*
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+L011600 1111111111110111*
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+L011616 1111111111110111*
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+L011632 1111111111101111*
-L011648 1111111111111111*
+L011648 1111111111101111*
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+L011664 1111111111011111*
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+L011696 1111111101111111*
-L011712 1111111111111111*
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+L011728 1111101111111111*
-L011744 1111111111111111*
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+L011776 1111011111111111*
-L011792 1111111111111111*
+L011792 1110111111111111*
-L011808 1111111111111111*
+L011808 1110111111111111*
 L011824 1111111111111111*
 L011840 1111111111111111*
 L011856 1111111111111111*
@@ -352,19 +352,19 @@ N Aclk ClkOp Clk:2 ClkFreq R:2 P:2 RegMod:2 INz:2 FB:2 InReg St XorIn:2 RegCom O
 L012464 000001111001111110011111100*
 L012491 000001111001111110011111100*
 L012518 000001111001111110011111100*
-L012545 000101111001111101000000011*
+L012545 000101111001111100000000011*
-L012572 000101111001111100100000011*
+L012572 000101111001111101100000011*
-L012599 000101111001111100100000011*
+L012599 000101111001111101100000011*
 L012626 000001111001111110011111100*
 L012653 000001111000011100011111100*
-L012680 000101111001111100100000011*
+L012680 000101111001111101100000011*
 L012707 000001111001111100011111100*
-L012734 000101111001111100100000011*
+L012734 000101111001111101100000011*
-L012761 000101111001111100100000011*
+L012761 000101111001111101100000011*
-L012788 000101111001111100100000011*
+L012788 000101111001111101100000011*
-L012815 000101111001111100100000011*
+L012815 000101111001111101100000011*
-L012842 000101111001111101100000011*
+L012842 000101111001111100100000011*
-L012869 000101111001111101100000011*
+L012869 000101111001111100100000011*
 
 Note Block 2 *
 Note Block 2 ZIA *
@@ -753,5 +753,5 @@ L025810 0*
 Note I/O Bank 1 Vcco *
 L025811 0*
 
-C0459*
+CFB9B*
-AA99
+AA89

firmware/cpld/sgpio_if/top.vhd

@@ -137,7 +137,11 @@ begin
     begin
         if rising_edge(host_clk_i) then
             if transfer_direction_i = to_dac then
-                dac_data_o <= (data_from_host_i xor X"7f") & "11";
+                if codec_clk_i = '1' then
+                    dac_data_o <= (data_from_host_i xor q_invert_mask) & q_invert_mask(0) & q_invert_mask(0);
+                else
+                    dac_data_o <= (data_from_host_i xor X"80") & "00";
+                end if;
             else
                 dac_data_o <= (dac_data_o'high => '0', others => '1');
             end if;